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三、集成的内存控制器
Hammer的另一个主要特点就是它把原来在计算机控制电路北桥芯片中的“内存控制器”直接集成到CPU内部。在当前的Hammer处理器中是把目前最为主流的DDR-I内存控制器集成于CPU内部，支持DDR1600/2100/2700规范，64/128位宽。在将AMD承诺将继续支持后续的DDR内存控制器标准，如即将于明年发布的DDR-Ⅱ。
这样一来是大大减少了CPU访问内存的延时，而且随着处理器频率的提高，这个时间将越来越短。因为以前CPU要访问内存，还必须经过一大堆电路，迂回各种总线才能到达，所需时间较长。主要表现在两个方面，一方面在Hammer处理器中把内存控制器集成在CPU内部，则CPU只需要通过后面将要讲到的超宽HyperTransport总线进行访问即可。另一方面由于内存控制器集成后，在多处理器系统中，加速了系统对内存的访问，减少了碰撞的发生。原来在多处理器系统中由于是共享内存控制器，在多用户同时访问时，经常可能会发生碰撞，另外由于是共享，所以往往是CPU实际利用率会大大下降，因为只有等一个访问结束后，另一CPU才可能去访问内存控制器，这样在多处理器系统中，就有可能经常造成CPU实际利用率不足的局面。但在Hammer处理器中通过内置的DDR-I控制器，可以避免这种情况的发生。
集成内存控制器的另一个优点就是，AMD再不必受制于芯片组和芯片组所支持的内存了。在以前，经常会出现芯片组集成的低下的内存控制器很大程度上限制了系统总体性能的发挥，这样一来AMD就确保了内存控制器的优良性能。为了提升内存控制器性能，制造商不断推出新的修订版本。除此之外，由于再也不必通过处理器总线传输数据，所以又消除了一处系统瓶颈。
也有人提出了这样的疑问，就是在CPU内部集成了内存控制器，虽然在访问速率上可能有些提高，但是也就失去了灵活性。因为原来内存控制器是在芯片组中，随着内存控制技术的发展，只需要相应的芯片组供应商进行芯片升级更换，就能非常轻易地实现内存控制器的升级，相对在CPU内部进行改进更加方便。如，现在目前的主流内存控制器仅为DDR-I，但是很快将会出现更新的DDR标准DDR-Ⅱ，而AMD计划将于今年年底出来的第一批Hammer肯定只能是集成DDR-Ⅰ了，那等明年三星等其它DDR内存重新发布了新的DDR-Ⅱ内存标准后，则AMD的Hammer CPU也就得重新设计，这样肯定会带来许多难度。这一点其实根本不用我们担心，因为AMD在设计时早就考虑到这一点，但是由于时间的关系又不可能等到DDR-Ⅱ标准出来后再来生产Hammer处理器。在这种情况下，AMD在设计上作了充分的优化，使得重新更改内存控制器变得十分容易，所以这一点对于AMD来说也不是什么难事。为了说明这一点下面介绍一下有关AMD Hammer处理的内存控制器工作原理。
下图5是Hammer与内存控制器相关的芯片部分。
图5
在上图5中“Memory Controller(MCT)”那一部分就是“内存控制器”了。MCT是作为Hammer处理器核心和DCT联系的桥梁。在这种架构中，DCT决定了相应内存的种类，而不是MCT。因此，AMD可以通过更换DTC电路的设计提供对各种内存模组的支持。通过这种灵活的技术就可以很容易的达到支持新内存规范的目的，而无需重新设计或更换架构。所以AMD对新的内存控制器的支持抱有绝对的信心。
由于内建了内存控制器，这就为研发Hammer的单芯片平台提供了可能性。而AGP控制器则可以从北桥移到南桥中去。事实上，矽统(SiS)早就通过将南北桥整合在同一片芯片上，为我们提供了单芯片解决方案。其实，研发Hammer会是件很简单的事情：没有了内存控制机构，将在设计中减少不必要的麻烦，而且还会加快芯片组的开发进度。这样的解决方案还可以很大程度上简化主板的设计工作，降低成品的成本，有助于扩大非高端处理器的市场份额。
另一方面由于内存控制器集成在CPU内部，这样就减化了多处理器系统的主板芯片组的设计。不同于Intel芯片的服务器，在使用一颗、两颗、四颗或八颗处理器时，需要搭配不同的芯片组，AMD的Athlon和Opteron服务器基本上都可采用相同的芯片组，不论配载的处理器数量多少。这样含四颗处理器的Opteron服务器，不会变成架构和芯片组与采用单颗Hammer芯片不同，而是只要把普通的单处理器机器复制四倍即可。如果按AMD 行销副总裁Ed Ellett的话来说，就是“没必要使用多重的芯片组和多重的设计。”他还说：使用相同的芯片组，也会降低企业用户采用新芯片的成本，因为信息科技管理员只需学习如何维护一种基本的计算机。Mercury Research处理器产业分析师Dean McCarron也认为Hammer是“相当优良”的设计。上一页 1 2 3 4 5 6 7 下一页 |
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